模拟IC设计工程师

参与模拟IP的架构方案讨论与电路实现，协助完成从晶体管级设计到仿真验证的全流程工作。 在资深工程师指导下，完成模块级电路仿真（前仿/后仿）、版图设计指导与物理验证，参与性能指标（精度/功耗/噪声/转换效率/驱动能力等）的评估与优化。 参与芯片测试方案制定、实验室调试与问题定位，支持产品量产相关基础工作。 撰写模块级设计文档，跟踪行业前沿技术动态。

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   教育背景 专业：微电子、集成电路设计、电子科学与技术等相关专业，202X届硕士或博士毕业生。 核心知识：扎实掌握模拟集成电路设计、半导体器件物理、信号与系统等核心课程知识，对半导体工艺制程有基本认知。

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   专业技能 设计工具：熟练使用Cadence Virtuoso（含Schematic/Layout）、HSPICE/Spectre等电路设计与仿真工具；了解版图设计及物理验证（DRC/LVS）基本流程。 分析能力：理解工艺角（Corner）、蒙特卡洛（Monte Carlo）仿真分析方法，具备基本的器件失配与噪声分析能力。 基础电路：熟悉至少以下一类模拟电路模块的基本工作原理——ADC/DAC、Bandgap基准源、LDO、电荷泵（Charge Pump）、Gate Driver、运算放大器等。

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   项目/科研经历（满足任一即可） 有模拟IC相关的课题或项目经历，完成过完整的电路设计-仿真-版图流程。 参与过芯片流片（含MPW（多项目晶圆））项目，有实际测试数据分析经验者优先。 在“集创赛”、“华为杯”研究生电子设计竞赛等专业竞赛中获得省级以上奖项。

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   综合素质 英语能力：能熟练阅读英文技术文档及学术论文。 细致与逻辑：模拟设计对细节要求极高，要求候选人具备严谨的逻辑思维能力和足够的耐心与细致度。 学习与沟通：具备良好的团队协作精神和沟通能力，有主动学习新技术、新架构的自驱力。 加分项 有高精度SAR ADC/Σ-Δ ADC、低噪声运放等信号链模块设计经验。 有LDO、电荷泵、DC-DC、Gate Driver等电源管理模块设计经验。 有BCD工艺或先进工艺节点（如28nm/22nm及以下）模拟设计经验。 熟悉数字校准/修调（Trimming）技术或低功耗设计技术。 博士期间有模拟IC方向高水平论文（ISSCC/VLSI/JSSC/CICC等）发表。